
Bit 5 STALL: SCL stall error (when the I3C acts as target) 0: no detected error 1: target detected that SCL was stable for more than 125 µs during an I3C SDR data read (during a direct CCC read, a private read, or an IB) I3C有个error寄存器如上,为SCL stable时间超过125us会触发这个时间,但是我这边主机发的波形上所有SCL的持续时间都是不超过1us级别的,从机这边就一致报上述错误. 当我把SCL的总体频率上调到2Mhz+的时,从机才不会产生这个错误,不知道为什么。 |
同样的都是M33核,什么决定频率上限?
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