SDIO_CK = HCLK/（ 2+CLKDIV）为什么要加个2

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黑皮男提问时间：2015-5-19 17:26 /

赞收藏评论10 发布时间：2015-5-19 17:26

10个回答

laotui 回答时间：2015-5-19 17:28:22

+1还可以理解，不知道为什么加2

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黑皮男回答时间：2015-5-19 17:40:07

laotui 发表于 2015-5-19 17:28
+1还可以理解，不知道为什么加2

已明白，至少需要一个2分频，保证当用HCLK做时钟源时频率不会超

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laotui 回答时间：2015-5-19 17:41:16

黑皮男发表于 2015-5-19 17:40
已明白，至少需要一个2分频，保证当用HCLK做时钟源时频率不会超

原来如此谢谢告知

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埃斯提爱慕回答时间：2015-5-19 23:23:09

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zhangdaijin 回答时间：2015-5-19 23:54:16

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黑皮男回答时间：2015-5-20 08:18:32

laotui 发表于 2015-5-19 17:41
原来如此谢谢告知

今天又看了下资料，其实不是这样，而是因为SDIO 需要两个时钟，一个是SDIO adapter clock (SDIOCLK = HCLK)，另一个是AHB bus clock (HCLK/2)

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黑皮男回答时间：2015-5-20 08:18:50

dsjsjf 发表于 2015-5-19 23:23
原来如此

今天又看了下资料，其实不是这样，而是因为SDIO 需要两个时钟，一个是SDIO adapter clock (SDIOCLK = HCLK)，另一个是AHB bus clock (HCLK/2)

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黑皮男回答时间：2015-5-20 08:19:09

黑皮男发表于 2015-5-19 17:40
已明白，至少需要一个2分频，保证当用HCLK做时钟源时频率不会超

今天又看了下资料，其实不是这样，而是因为SDIO 需要两个时钟，一个是SDIO adapter clock (SDIOCLK = HCLK)，另一个是AHB bus clock (HCLK/2)

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为什么是EEFOCUS小白回答时间：2015-5-20 08:51:34

原来如此

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埃斯提爱慕回答时间：2015-5-20 22:15:47

提示: 作者被禁止或删除内容自动屏蔽

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