STM32G474时钟设置笔记（170MHz）

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STMCU-管管发布时间：2020-9-18 10:46

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编写基础RCC（Reset and Clock Control）

AHB、APB1、APB2最大频率都是170MHz。

R8 r! }# t! h7 \- b

时钟树

要想配置时钟首先必须要看明白时钟树。$ \0 A/ K1 ~9 ^6 d5 ?" S& e( \8 `9 f' Q

PLL

配置时钟精髓就是PLL倍频，因此搞清楚了它就很好解决了。

; P0 M. g; r5 s6 c# t8 N
手册上对PLL配置步骤如下图：

/ N6 k0 y0 _1 r& a3 D8 y6 R

首先通过上面的时钟树也可以看出来PLL的时钟源有两种：HSI、HSE。PLL的分频、倍频配置在RCC_PLLCFGR寄存器中。
配置PLL的过程是：

将RCC_CR的PLLON位清零来关闭PLL。
查询RCC_CR的PLLRDY是否被清零了，如果该位为0说明PLL已经关闭。
配置分频、倍频系数等（单纯的使能或者关闭PLL_P、PLL_Q或者PLL_R不需要这些步骤，直接操作即可）。
将PLLON设置为1，再次启用PLL。
通过在RCC_PLLCFGR寄存器中配置PLLPEN、PLLQEN、PLLREN来启用所需的PLL输出。注：PLL输出频率不得大于170MHz。当一个时钟源被直接使用或通过PLL作为一个系统时钟，是不可能停止它。
! D' M1 R2 G# m/ n
i7 D G4 @$ C( \

7 M( B8 x1 p. H- p; S6 d; A, S) D+ r: [0 W7 S8 f* _) r) Z0 W, \

PWR

在不同的工作频率下，对应的电源模式也不一样。

: V" g$ U2 v; n; y可能是为了满足不同频率下的功耗管理，高时钟对应高内核电压，我使用TI的5529时也有倍频时修改内核电压的的操作。
! J6 x0 s$ z- g0 t; r% Cg474的电源模式与各个时钟频率对应关系如下表：

' |& L! s9 _1 C

PWR_CR1的VOS[1:0]对应Range2和Range1：

3 }9 x7 f* S P# N! q+ U) @

至于Range1的normal模式和boost模式是在PWR_CR5寄存器的R1MODE位配置，R1MODE为0就是boost模式：

5 W2 h; r J) c

g474的R1MODE位与SYSCLK的对应关系如下：

" G! i# J- m4 p) r3 m# }# a0 _

手册中还介绍了从range_normal切换到range_boost模式的步骤：

4 G, F& G: Y4 W

在切换到更高的系统频率之前，系统时钟必须用AHB分频器除以2。
清除的R1MODE位在PWR_CR5寄存器中。
在range1 boost模式中，根据新的频率目标调整等待状态的数量。
配置并切换到新的系统频率。
等待至少1us，然后重新配置AHB预压器以获得所需的HCLK时钟频率2 n/ Z- x: H* ?# S( M
: o5 _6 X# n1 n- H6 D

w% G* B$ | z
$ g5 o8 E0 _! o

FLASH

这个是我原来忽略的地方，原来就配置了PLL和PWR，然后倍频到140MHz就是极限了，后来我反复查阅手册，才发现了原来少了对FLASH的访问比率的配置。（可以看到上面的range_normal切换到range_boost模式步骤里已经提到了修改FLASH访问比率的事，但是由于没看懂是什么意思，还以为是延时1us，因此配置170MHz时候就失败了。）

- |9 M8 {5 n! U4 a7 p3 E

上面提到range_normal切换到range_boost步骤里有这么一句：

* l, a9 G' h R4 {1 h' e: o, a

在range1 boost模式中，根据新的频率目标调整等待状态的数量（FLASH_ACR的LATENCY位）。
: L1 k& ]6 M9 @6 @7 j
2 x2 B n, u& p4 s( B2 p! A

那么就看看这个 FLASH_ACR 的 LATENCY到底是个什么。

& K( J0 ~8 L6 A' U查阅手册找到这个寄存器：

+ M5 C2 ]; F$ N7 b3 I

可以看到LATENCY在最低位：

' ~. W2 j0 y3 }, B) s. M( \

LATENCY[3:0]：这些位表示SYSCLK(系统时钟)周期与Flash访问时间的比率。

; e: F& `* y9 N8 V& c+ n: `1 O- B知道了它是干嘛的，那么它到底设置为多少合适呢？如下图所示：

, k# k* w& Z3 [) d7 l" q* \/ V

为了正确地从闪存读取数据，等待状态(延迟)的数量必须根据CPU时钟(HCLK)的频率和内部电压范围的设备VCORE被正确地编程在闪存访问控制寄存器(FLASH_ACR)。参考第6.1.5节:动态电压缩放管理。表29显示了等待状态和CPU时钟频率之间的对应关系。

1 O; w9 N" x& D6 F2 o H

对号入座，我要设置为170MHz，模式为Range 1 Boost模式，那么对应LATENCY值应该为4WS，因此将其配置为4。

" ?6 D7 u6 a* I/ |

FLASH->ACR |= FLASH_ACR_LATENCY_4WS;

+ n; Z; j( n7 @) z

配置函数

有了上面的概念就可以进行编写时钟函数了。: e1 p; O* B8 Y& g/ ?
步骤如下：

! k2 ^! S, Y* J4 j

开启HSE（鄙人的板子HSE为8MHz）并确认HSE就绪；
关闭PLL并确认PLL已经关闭；
AHB二分频；
配置为range1_boost（默认复位为range1_normal模式）；
配置FLASH_ACR的访问时间比率；
配置PLL；
打开PLL并确认PLL就绪；
使能PLL_R；
配置系统时钟为PLL输入，并确认系统时钟就绪；
延时至少1us后切换AHB为不分频。  j4 F0 V7 J, b. g, ~/ N% @

- F- B. b! j! W5 t6 X" L3 Y8 S# H9 H' O# m

u8 SYSCLK_140MHz(void)1 y! n  d& ~) N$ R, ~" x8 ^

{
9 L% X9 l* w/ }' l- L$ u+ M
      u16 temp = 0x2000;
1 f2 U* s3 c0 \1 L4 v# V' m
      RCC->CR |= RCC_CR_HSEON;//打开HSE" V* I1 ^/ q2 x

      while((!(RCC->CR & RCC_CR_HSERDY))&&(--temp));//等待HSE就绪
% D/ h  u; T. S( h& a1 G9 B
      if(!temp)//检查是否超时
  I& V2 ?% ]0 E+ z. Q7 P, M4 ^
      {
2 l8 W7 }& S* ^% P7 V
            return FAILED;- U  W7 k* h& X# S( I7 s

      }
- C7 m' ?- z/ I3 S) a
      RCC->CR &= ~RCC_CR_PLLON;//关闭PLL
7 J, w0 \  `3 H: d: h
      temp = 0x2000;, \9 x  {3 H0 @) D

      while((RCC->CR & RCC_CR_PLLRDY) && (--temp));//等待PLL下线4 y8 _! |9 A4 G9 |& x% \

      if(!temp)//检查是否超时% i0 t! p0 U& Y* _' M  S$ K

      {
( m3 T; w! N# N+ g' d; E
            return FAILED;! U( m: T$ P2 z4 O

      }- J4 M! c& S- a: L

      RCC->CFGR = RCC_CFGR_PPRE2_DIV2|RCC_CFGR_PPRE1_DIV4|RCC_CFGR_HPRE_DIV2|RCC_CFGR_SW_HSI;
7 G: ]% H8 r5 E
      //系统时钟选择内部高速时钟，AHB二分频，APB1四分频，APB2二分频" `% i4 [: Y- b- w3 U7 M0 y

      temp = 0x2000;
& N8 i: y" J' Y* j; T
      while(--temp);//等待AHB稳定
+ K, d9 N' @5 B# T5 X
      PWR->CR5 &= ~PWR_CR5_R1MODE;//设置为range1_boost模式) j8 X3 W7 `9 ^2 Z: L8 K

      FLASH->ACR &= ~FLASH_ACR_LATENCY;//清除LATENCY" E3 U7 A! t: c

      FLASH->ACR |= FLASH_ACR_LATENCY_4WS;//配置LATENCY为4WS
, W5 j2 N9 Q" X
      temp = 0x2000;: a% j( j+ o( O5 Q4 D9 N/ H

      while(--temp);//等待系统稳定( R, P! F- D# r2 p9 ]4 i4 D

      RCC->PLLCFGR = (70<<RCC_PLLCFGR_PLLN_Pos)|(1<<RCC_PLLCFGR_PLLM_Pos)|RCC_PLLCFGR_PLLSRC_HSE;//(8*70)/2 = VCO = 280MHz
6 F- X  P9 l; K, B. {2 o& Z& w
      RCC->CR |= RCC_CR_PLLON;//打开PLL
) y& \/ d6 h3 z) j! V$ b
      temp = 0xf000;1 ]! _9 E) ^  G' ]" R

      while((!(RCC->CR & RCC_CR_PLLRDY)) && (--temp));//等待PLL准备就绪! g7 V% Y! g( D+ y" e+ S

      if(!temp)
0 F4 e& p0 b7 [- a, ~! ~
      {7 [( _$ |7 J8 B0 x1 ]4 I

            return FAILED;$ {, l! H- P& J" Z( b9 i$ V

      }
( M' r2 ~* E  [9 j/ i9 d, K  e
      RCC->PLLCFGR |= RCC_PLLCFGR_PLLREN;//使能PLL_R  o; J) v: f6 ^- I6 \/ y" n

      RCC->CFGR |= RCC_CFGR_SW_PLL;//设置系统时钟选择PLL
8 X& q& D0 ^- T; V3 I# N; ~" k; R
      temp = 0xf000;
" c+ o" v% e0 k+ R" p. o* J; T! l
      while(((RCC->CFGR & RCC_CFGR_SWS) != RCC_CFGR_SWS) && (--temp));//等待系统设置PLL主时钟完成标志位置位
3 z% y6 ?' C$ D$ {- ~* L" B2 T3 Y( U: b
      if(temp)
/ c. f# R; P; h1 w
      {
, t$ X. N2 [# F- R
            temp = 0;) r4 N) a3 q. ~, l: j5 `

            while(--temp);//等待系统稳定* P( G  U' ^: J0 r( k# I& b) U

            RCC->CFGR &= ~RCC_CFGR_HPRE;//AHB 不分频 == SYSCLK
& R# `- {" V, ~* _- h
            return SUCCEED;
8 S" x; @  E: y8 ^) E$ ~" o/ z
      }
& \' \. F) P' F# [2 \% g# q+ y( P
      else
- a' T: P" P% I  V* ~1 w
      {  Y* }  e) x* [0 t% ]) v

            return FAILED;' @" N; l; c1 P4 [% J. b

      }       + _4 _7 ~8 [9 h  F

}
复制代码

! I: }) p; x' U; n! ]1 E0 [4 [: W; a% i+ g, M6 v, W

然后就配置结束了，通过定时器验证确实为170MHz。

; Z% y! V& t' y8 O1 u: A

( U: b, G* [, }+ o

附录：RCC寄存器

最后：

/ e* h' y9 o& U6 P1 d附上本人写的寄存器配置，方便个人配置，要啥直接删注释就好：

( m, y* P4 I: ~

//================================RCC->CR========================================
$ P! N% M8 v+ r% t4 l5 P
RCC->CR |= 0 //default: 0x0000 0063* b7 F" s+ h4 l% B
// //RCC_CR_PLLRDY //bit25【read only】: PLL Ready" ^2 e8 _# ?' u. s
// |RCC_CR_PLLON //bit24: 使能PLL。+ U v# g, _# s
// |RCC_CR_CSSON //bit19: 时钟安全系统使能。0 OFF ; 1 ON
3 r" n" J1 I0 _. @, H# I
// |RCC_CR_HSEBYP //bit18: 0 HSE晶振不旁路 1 HSE晶振旁路
$ a% l% ~7 A; w! t6 M, M
// //RCC_CR_HSERDY //bit17【read only】: HSE Ready. v8 F1 J0 u2 A5 o( p! c4 X
|RCC_CR_HSEON //bit16: 使能HSE
. F$ N. @1 e, E9 o
// |RCC_CR_HSIRDY //bit10: HSI16时钟准备就绪( h% _- q/ d* }, p
// |RCC_CR_HSIKERON //bit09: 停止模式HSI是否启动2 v3 q1 v. W6 R1 l7 v
// |RCC_CR_HSION //bit08: 1 HSION 0 OFF
8 ]- V. q/ e# n& t4 l
;- W: E( v# [ v/ G$ e5 v/ o" L
. u1 X0 }5 N( ^+ H$ e y4 C
//================================RCC->PLLCFGR ========================================; V) _" J4 X& Q: L6 m, ?9 y) b
RCC->PLLCFGR = 0 //default: 0x0000 1000
* |, [' k- \) o! f% r( Y1 ~( I
// |RCC_PLLCFGR_PLLPDIV //bit31-27[4:0]: P 分频给ADC用0 h, ]8 ^9 i, E0 s
// 00000: PLL “P” clock is controlled by the bit PLLP
' M! u- w* O* Z" D) B9 L& S
// 00001: Reserved.
' z: v! `) n6 a& N1 ?! o
// 00010: PLL “P” clock = VCO / 2* |2 \) e8 o/ m% n
// ....0 Y% `9 W9 |& C. n) e {
// 11111: PLL “P” clock = VCO / 31, ^! e1 c( n1 I4 o' o
// |RCC_PLLCFGR_PLLR //bit26-25[1:0]: 锁相环R 分频/ C2 @3 z: `3 \4 L6 _
/// // 00: PLLR = 2
4 V2 G- }' z0 F: A
// 01: PLLR = 45 A- \8 [4 } a6 G
// 10: PLLR = 6# |3 Q* w7 H" }0 C$ K
// 11: PLLR = 8 j& Q6 U8 j( |8 X! I3 F
// |RCC_PLLCFGR_PLLREN //bit24: PLLR使能! e1 ~6 l S0 K2 V, y$ [1 Y4 L% [0 l
// |RCC_PLLCFGR_PLLQ_0 //bit22-21[1:0]: Q分频，USB用。分频参数与R分频一样$ q. c( b( U% j, I1 \0 D
// |RCC_PLLCFGR_PLLQEN //bit20: PLLQ使能$ U+ r" |! B7 Z' `
// |RCC_PLLCFGR_PLLP //bit17: P 分频
: X% I: A8 L+ f6 g
// 0: PLLP = 7
- v! F* b1 C) N# E3 I* T" m
// 1: PLLP = 17
, K9 w( D! a/ \( v& u; j% c6 r( {5 S9 H
// |RCC_PLLCFGR_PLLPEN //bit16: PLLP 使能1 {; ?; e f( o2 K
//----------------------- VCO = 280MHz) ~, L3 a' W( u: h V
|(70<<RCC_PLLCFGR_PLLN_Pos)//bit14-08[6:0]: PLL的倍频不能小于8
" W% x/ g5 e9 A) Y# y
// 0000000: PLLN = 0 wrong configuration
& n! ]& C5 W9 ]" i2 Q) N) x( ~
// 0000001: PLLN = 1 wrong configuration3 V+ S' Z7 O, o# K, O
// ...2 O- c/ l7 i! J _4 }
// 0000111: PLLN = 7 wrong configuration
3 D+ ^5 l* w" R1 s
// 0001000: PLLN = 83 M4 T& h6 V& ]" D
// 0001001: PLLN = 96 N( m$ s$ {! A
// ...) X' Z3 k) p: M" t
// 1111111: PLLN = 127) l7 s0 p' a1 ?6 E5 Z: E/ _
|(1<<RCC_PLLCFGR_PLLM_Pos)//bit07-04[3:0]: PLL初始分频; I6 } B- ]8 ?4 ?
// 0000: PLLM = 11 D( t a" h4 Q' V) i2 n
/// // 0001: PLLM = 28 I% g+ @ D5 f; q4 U# Z* K
// 0010: PLLM = 30 A# |6 j1 u- z9 E( a' M: [# k
// 0011: PLLM = 4! y/ X1 c( e) ~' A3 W
// 0100: PLLM = 5: y4 ~' w6 K4 b+ J2 O' y' I
// 0101: PLLM = 6
1 F# R5 F( |6 g- k1 @
// 0110: PLLM = 7. W4 U5 J2 C- n! f" ^. t
// 0111: PLLM = 8
5 O7 }8 F5 t3 \: p9 ~3 R/ d
// 1000: PLLSYSM = 9% ^/ n5 _ ?; H- {2 z4 L9 d% o
// ...
9 G: l/ @8 \# s8 P6 f" j
// 1111: PLLSYSM= 16 Y3 ]* i. ?2 v
|RCC_PLLCFGR_PLLSRC //bit01-00[1:0]: PLL时钟源选择。
, U! M G- D8 K7 R k
// 00: No clock sent to PLL! u2 e& ]$ _. s) e( Y3 \
// 01: No clock sent to PLL8 A, ?) x) r1 |( l* m
// 10: HSI16 clock selected as PLL clock entry9 n8 V' t- o5 x: t& |% o M. ^
/// // 11: HSE clock selected as PLL clock entry
2 Y6 ]1 M0 N0 k+ Q. O8 g' P
;7 y" }9 h( l. H9 z
5 J8 H. L, ]) f1 x/ o4 [: @' q0 Z# d' r
//================================RCC->CFGR========================================
' U. U+ u( {1 S3 F7 K
RCC->CFGR = 0 //default: 0x0000 0005
; i5 z$ U9 p K* o# W& b
// |RCC_CFGR_MCOPRE //bit30-28[2:0]: MCO输出时钟分频; q8 r# c' Z. D* x8 i3 n/ Y4 m
// 000: MCO is divided by 1
- `% _% y% {! Z4 _& C7 q
// 001: MCO is divided by 2
0 X: Z) |0 n- I9 b
// 010: MCO is divided by 45 K. j: E, l* z# F
// 011: MCO is divided by 8
2 X, a! @$ S5 C% S7 Y7 G
// 100: MCO is divided by 16
9 K+ }6 s% R8 j6 B2 E
// Others: not allowed) F/ B% S! \! T/ O* J
// |RCC_CFGR_MCOSEL //bit27-24[3:0]: MCO输出时钟选择) z( b/ O$ m; s
// 0000: MCO output disabled, no clock on MCO9 e# ]3 J7 I1 B @# f
// 0001: SYSCLK system clock selected
7 D# o3 Y( Z; E" W
// 0010: Reserved, must be kept at reset value4 `* |! |0 c1 S4 t/ C: A8 K
// 0011: HSI16 clock selected1 Y1 k9 U1 H4 Q5 X# h% l O9 W
// 0100: HSE clock selected
# g3 |' }# P/ }+ X% {
// 0101: Main PLL clock selected
2 Z. S' n+ z, w' q' m
// 0110: LSI clock selected
, N3 T3 o L; Z- }
// 0111: LSE clock selected( @0 l0 z; o& {
// 1000: Internal HSI48 clock selected9 r. {% d2 ?6 u) {) }
|RCC_CFGR_PPRE2_DIV2 //bit13-11[2:0]: APB2预分频9 \, \( e7 B* n2 R. w8 ]9 X: t
// 0xx: HCLK not divided
# U. Y) l5 p T) R+ R! j' h
// 100: HCLK divided by 2) a! \0 V% _. S _ o
// 101: HCLK divided by 47 L4 v+ M' r4 m
// 110: HCLK divided by 8
$ d/ c6 n# m! {) c% r5 F( q [
// 111: HCLK divided by 16
! h8 Z$ \* L: C4 h' j4 |7 F8 S! a
|RCC_CFGR_PPRE1_DIV4 //bit10-08[2:0]: APB1预分频1 R" q8 E4 O4 p" P( a" b8 q8 t
// 0xx: HCLK not divided
& L: ~: V X' l2 j- }3 E2 r. Z
// 100: HCLK divided by 2
) T7 q/ Q1 a# A9 I8 c" N: b
// 101: HCLK divided by 4
/ }+ D6 w* ]/ P0 `- u
// 110: HCLK divided by 8
! o4 q- T. N% ?! D! l
// 111: HCLK divided by 16
$ A+ x/ U/ c9 G- J6 M; {
// |RCC_CFGR_HPRE //bit07-04[3:0]: AHB预分频（改变core电压之前应该先查看这些时钟频率）
- s3 [# j8 f0 Y6 W
// 0xxx: SYSCLK not divided
" u( X& i5 m' V7 }' P
// 1000: SYSCLK divided by 2
/ }- E6 R2 `7 x# W2 c. Z8 u- {
// 1001: SYSCLK divided by 44 d$ E7 i5 H2 B$ Y+ \% m7 ?5 h9 Y9 x
// 1010: SYSCLK divided by 8. u) M& b$ R: L
// 1011: SYSCLK divided by 162 p8 ~ I2 W; C$ d9 ~. Q4 A; E, u' f
// 1100: SYSCLK divided by 64* N: L% f# S J6 w7 x
// 1101: SYSCLK divided by 128! k* U/ r+ O/ O; o
// 1110: SYSCLK divided by 256$ S1 o! X4 f; ~0 a n
// 1111: SYSCLK divided by 512
: v7 y4 k5 M: O: ^9 S: e
//RCC_CFGR_SWS //bit03-02[1:0]【read only】:系统时钟源选择状态，该位与SW对应。2 h" A6 Z n+ `, D$ M
|RCC_CFGR_SW //bit01-00[1:0]: 系统时钟源选择。
. }+ }! t' O% I2 Y& y. @ ^7 N
// 00: Reserved, must be kept at reset value
* W$ j& N/ u: ^3 j8 o4 b7 K1 Z7 N
// 01: HSI16 selected as system clock
* G# O3 ~1 g4 [9 ?% r$ L
// 10: HSE selected as system clock. X4 A/ f8 |+ j2 e' x/ U* f m
/// // 11: PLL selected as system clock" A# I+ i% Z0 B( i. M4 W+ G$ j
;

复制代码

下面是RCC寄存器：

void RCC_Init(void)
6 X6 [2 t! q% @+ O. x8 Y
{
2 B4 \' b' a0 f0 g4 j( ?3 S' w
//--------------------------------------------------------------------------------------//$ A) y' E! S( d
//---------------------------------------- AHB1 ----------------------------------------//
' b, e: l7 z+ A3 V/ {
//--------------------------------------------------------------------------------------//
. x3 E9 c) m; Z4 D+ I0 l: Y( I C
RCC->AHB1RSTR |= 0 //default: 0x0000 0000
+ L$ S5 K* F" [* t& M( P
// |RCC_AHB1RSTR_CRCRST //bit12$ y; |5 v2 K9 k1 z
// |RCC_AHB1RSTR_FLASHRST //bit08( O, r5 R: }2 n+ Y: Q. O4 d/ y& I
// |RCC_AHB1RSTR_FMACRST //bit04
" q. `; z8 ~# A& f5 W0 Y L0 B6 k
// |RCC_AHB1RSTR_CORDICRST //bit03* \7 { w6 Q; w
// |RCC_AHB1RSTR_DMAMUX1RST //bit02
5 J, H Z' N: N* ^+ ]
// |RCC_AHB1RSTR_DMA2RST //bit01
W4 ^% D& O+ m+ s+ p M: ^
// |RCC_AHB1RSTR_DMA1RST //bit00% q% |) W9 |" N$ t- `% n+ B9 i
;
* }9 M6 W1 n1 x+ w1 t
RCC->AHB1RSTR &= 0xffffffff //default: 0x0000 00001 H0 C7 S/ P( j
// &~RCC_AHB1RSTR_CRCRST //bit12
& M1 X. L, [( A( U
// &~RCC_AHB1RSTR_FLASHRST //bit087 @' ~6 v, w8 M; b( \
// &~RCC_AHB1RSTR_FMACRST //bit04/ N; z* E6 [) P
// &~RCC_AHB1RSTR_CORDICRST //bit03
4 W, P5 ?, \7 R* N1 x; C: ]8 Y) F
// &~RCC_AHB1RSTR_DMAMUX1RST //bit02& x1 l) E/ p9 u' z: J: K
// &~RCC_AHB1RSTR_DMA2RST //bit01
" I4 r* t" c* T2 `5 j- F
// &~RCC_AHB1RSTR_DMA1RST //bit00
2 h( J; \; @4 N9 a
;% V4 F. \- L4 p+ g" w# @
4 `) p+ q9 v* r" [8 R) a1 p
RCC->AHB1ENR |= 0 //default: 0x0000 0100
2 ]$ t$ c- t' n# r* G: T
// |RCC_AHB1ENR_CRCEN //bit124 \' E& k! ~& O$ `0 {
// |RCC_AHB1ENR_FLASHEN //bit08
, [, \. p( S1 \8 s2 v3 T
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Y! c3 t8 \$ V, e6 k* Z
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U0 }5 W. C* r+ ?1 b# }
// |RCC_AHB1ENR_DMA2EN //bit018 V' Y) w/ @4 D, ~* f; ^% c
// |RCC_AHB1ENR_DMA1EN //bit00
1 `! Z2 y, p$ P! r9 _
;
: z" ]1 x. q9 Y. ~
//--------------------------------------------------------------------------------------//+ H$ m% \3 P" u1 S8 m2 @, x
//---------------------------------------- AHB2 ----------------------------------------//3 ?+ L' d* I' N9 ~0 ?/ s% N
//--------------------------------------------------------------------------------------//9 T# M: `- L" L
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1 F6 k- k) }- Q0 J9 f! l( k- s
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6 U7 u- m( M# n$ H |( ?! x
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; r4 V( _5 ?( C7 e+ e$ d
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1 F2 o- ?5 D# F
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8 m0 Z% }& a% _- ]+ z& {6 T
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7 F9 M, p: U2 q/ h; v. H2 S, w7 ?
// |RCC_AHB2RSTR_GPIOERST //bit04
3 J3 a" W; w; ]( p0 `/ R( S# B
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+ V' Q! m. {# P) b% q ^6 g( P
|RCC_AHB2RSTR_GPIOCRST //bit02
! b2 D H; e% \7 r# ?
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# D# H+ ]9 f$ z1 O# G# r. g- U
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;( a% O6 X4 ?, R+ C0 `2 c. n0 F/ L
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0 d2 L( B( M! z6 X" V
// &~RCC_AHB2RSTR_RNGRST //bit24. L4 t v0 \: j g, R8 F
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+ p: J$ f7 d, b! h2 _
// &~RCC_AHB2RSTR_DAC3RST //bit188 U2 F* y* T( S6 T3 x4 _6 q
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]5 e! J4 k3 \2 h% W% m6 i- m
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; O4 T0 Z# e, O: P2 t! @
// &~RCC_AHB2RSTR_GPIOGRST //bit06+ y/ b- f* q' C7 I/ x, Z# f/ {5 i5 a
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, }% ~1 ?1 Q0 L' v! _0 }
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2 R. O. }: q! r7 H+ ^: _
// &~RCC_AHB2RSTR_GPIODRST //bit03
D; k+ S( O4 z r( m
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// &~RCC_AHB2RSTR_GPIOARST //bit00% o2 g; `2 }6 Q3 ` W |1 B
;
) _: [4 s, Z* X' Z9 g
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# K' p- Y: e2 H! M( x
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$ d: I6 n3 H8 i# i4 j
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" @( L& p, a2 B- S9 B
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" w% z0 ~$ a% T, D" j) ^
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+ R$ _! O( `0 f+ n$ }6 \9 e/ ~5 ?
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3 U, | s! G1 b' m* H' t- m0 I
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: B0 s" e5 L6 A# S0 e# E" q
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! w* q" V1 A J5 G R1 ? ^
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;! @1 u. Q3 p, M1 F
//--------------------------------------------------------------------------------------//
- Y4 q- i% G6 C* U6 c
//---------------------------------------- AHB3 ----------------------------------------//
9 ]: X1 S9 W) u& ?1 s
//--------------------------------------------------------------------------------------//0 G7 P$ K3 k( C' M1 e1 F5 @( J7 H
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3 x0 w7 ~4 q: j2 d
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;
' O& {2 Z5 P+ B! X! ~! p3 Y
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// &~RCC_AHB3RSTR_QSPIRST //bit08
3 P5 j: z, L+ S. S! h
// &~RCC_AHB3RSTR_FMCRST //bit005 }' x& N8 d3 i" P6 N$ p5 J, m
;, t4 j' J& _) | A
L& i' X2 r) x d% y
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// |RCC_AHB3ENR_FMCEN //bit00
. E/ E. B; f* T S0 p8 \3 Q+ q
;
+ N! @5 @; k+ C) G! I
//--------------------------------------------------------------------------------------//
2 v+ \- E) a; t) v* g. B
//---------------------------------------- APB1 ----------------------------------------//8 T+ u7 H/ \9 |
//--------------------------------------------------------------------------------------//9 H9 r6 ~: \4 k: i
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; W }' n: h& k O: y
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7 s: k& ?" t& o
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1 U) Q, B7 A5 L! f. F3 W; l% D
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7 ~2 l6 q, V6 E$ J
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, A- x- I4 {1 h3 G! o% y* S8 w
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; a) w, r# {" e5 i/ y
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6 `+ E. ~* @( k+ ~- q( e
// |RCC_APB1RSTR1_TIM2RST //bit004 A [, Z+ ~8 x; u: @# w9 S* c
;+ i% r2 i8 O9 U) e- N T* n
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/ N D$ ^: {: K5 H0 g. S
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6 u% V$ V) J8 N
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5 k; }$ r6 |5 A/ M8 I8 q5 C
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! _% H3 i+ w' G1 _
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: @# C/ P0 ]1 X! g6 r- V, L
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% v- ~* ?4 O. g- s( S
// &~RCC_APB1RSTR1_USART2RST //bit17
: L2 d/ w9 x6 C* s# l
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! \. Y. \) m/ t8 _1 G! P; T2 f( W
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6 v3 v' o4 E/ | r) ? y
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;1 W: ~& ~+ J! d1 r; O5 L
/ l" Z8 G+ F8 H3 |; L) E& U
RCC->APB1ENR1 |= 0 //default: 0x0000 0400
! [( q+ K3 p% S K) h, G
// |RCC_APB1ENR1_LPTIM1EN //bit31
" T0 k' c+ {4 ~8 K6 }0 e
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J6 M& ^; y- {2 X, V! E
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+ i, m0 q) g7 x0 l2 } P
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# n7 W+ X& C8 J8 S3 L' U2 E
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i/ g4 W6 A5 z" x
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9 S% j0 d) `- }+ r4 }$ J; L6 h c6 w
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$ H1 w8 L/ O3 A3 K; w
// |RCC_APB1ENR1_SPI3EN //bit15
4 A- a, ?( W$ L
// |RCC_APB1ENR1_SPI2EN //bit14
- W! ?8 Z! Q3 @% e: d( H" A
// |RCC_APB1ENR1_WWDGEN //bit11
) b4 U" h; T4 M1 E7 {" o/ `4 s! O
// |RCC_APB1ENR1_RTCAPBEN //bit10
1 x* V3 i* [: B( s, `2 R4 k
// |RCC_APB1ENR1_CRSEN //bit08
7 y4 g$ d/ w1 _% a. U4 j8 L. T
|RCC_APB1ENR1_TIM7EN //bit05
) |4 H4 H/ |$ ?5 {: r$ c
// |RCC_APB1ENR1_TIM6EN //bit04
* Z z0 r2 E h4 b5 [0 S0 Q6 a
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8 v$ w5 f: I2 V( [6 r
// |RCC_APB1ENR1_TIM3EN //bit010 ]2 `9 @3 d5 q! C1 t8 d
// |RCC_APB1ENR1_TIM2EN //bit00, x, w/ x+ A; M3 _& \7 g
;
( Q& d; E4 ~$ y5 A7 b8 \
* G( }- C% S. x2 T
. Z$ a: b+ c' e8 @6 d, t& b" _+ [% |
RCC->APB1RSTR2 |= 0 //default: 0x0000 0000
- |0 a6 l: |6 s+ O) L& V1 E
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5 R3 C, K8 C2 l" P6 s
// |RCC_APB1RSTR2_I2C4RST //bit01
1 D* o+ Z$ J, _5 x. D
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;
1 n8 l2 x& p. R
RCC->APB1RSTR2 &= 0xffffffff//default: 0x0000 0000: j1 U; S) p, _: Q" ]& x- `
// &~RCC_APB1RSTR2_UCPD1RST //bit081 J2 \* v' x- A$ i
// &~RCC_APB1RSTR2_I2C4RST //bit019 z7 y O( G' ~0 h& N+ G0 g# a% [, E
// &~RCC_APB1RSTR2_LPUART1RST //bit007 b* B" S3 g& y O4 D
;
7 n. l) q4 b4 h: M/ G6 n
: C+ e) M8 x# L' @) q1 ~1 C
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// |RCC_APB1ENR2_UCPD1EN //bit08 t) E9 {6 x1 v( N% D% N) t4 N
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4 Z) ^ c; i. F0 _3 M( y4 L
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7 y$ n. D* N& O$ v# b/ z3 ~
;' D7 M, z$ }- `
//--------------------------------------------------------------------------------------//
7 I- D1 Y, R* B9 Q: k. ?. d7 D
//---------------------------------------- APB2 ----------------------------------------//# `1 I% O2 }8 m4 } B: x
//--------------------------------------------------------------------------------------//
& p/ u: h. r; H/ \: T
RCC->APB2RSTR |= 0 //default: 0x0000 00007 z4 r) o; ?' d9 l
// |RCC_APB2RSTR_HRTIM1RST //bit26
+ ]* F/ v5 G. B, Z
// |RCC_APB2RSTR_SAI1RST //bit21# X% p6 v/ u7 x' b
// |RCC_APB2RSTR_TIM20RST //bit20
, b- B8 X7 h! F3 O
// |RCC_APB2RSTR_TIM17RST //bit18
0 w! @$ p% {* r q
// |RCC_APB2RSTR_TIM16RST //bit17! ~+ K& s( _2 [5 ]/ u# h0 o. f, N* _
// |RCC_APB2RSTR_TIM15RST //bit16
; ]4 T9 R9 i+ [# `
// |RCC_APB2RSTR_SPI4RST //bit15
; O* | k$ b2 c3 i9 h
// |RCC_APB2RSTR_USART1RST //bit14: B* A' U( O9 D5 x" Z* [) ~: A
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;) d, J+ B7 Q0 `
RCC->APB2RSTR &= 0xffffffff //default: 0x0000 0000$ M% n) ]& q4 a- T }
// &~RCC_APB2RSTR_HRTIM1RST //bit263 E l( F, |/ O! i5 v
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// &~RCC_APB2RSTR_TIM20RST //bit20
7 Z) M9 x' d+ |& w" |7 |" C
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// &~RCC_APB2RSTR_TIM16RST //bit17
* i8 ]" u! o1 O
// &~RCC_APB2RSTR_TIM15RST //bit16
// &~RCC_APB2RSTR_SPI4RST //bit159 F* ~; U- ~: a
// &~RCC_APB2RSTR_USART1RST //bit14
, E% z2 S0 D5 T1 l# f8 c0 u
// &~RCC_APB2RSTR_TIM8RST //bit130 \9 Y" f u' K2 Y" `
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/ j# [- y6 ?- I
// &~RCC_APB2RSTR_TIM1RST //bit11% L' h4 Z! G2 r- M
// &~RCC_APB2RSTR_SYSCFGRST //bit00& Q7 t( G% J% J: s8 u
;2 k) R8 Y' f& ^# d7 Y9 z* b
# j; X7 e+ {* N% p5 N
RCC->APB2ENR |= 0 //default: 0x0000 0000
6 p8 M7 J6 g' p) Q& g1 _6 W
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, o- b B4 A: I
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! T% s8 O7 J1 X' X1 I" w V% {: M
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9 i, [ D) G! B5 P
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. }/ Y" l" y. G
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" n" B3 P9 V* J# l0 H" s! F* g
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6 I q6 U/ T6 y0 A
;2 @4 H- `" S3 [; |
}
: N$ Y7 ~; V* ]& I' T* T7 J L