有个项目要用到STM32F207Vx单片机,找到网上的例子照猫画虎的写了几个例子,比如ADC,可是到了ADC多通道转换的时候就有点傻眼了,这里面的时钟跑的到底是多少M呢?单片机外挂的时钟是25M,由于该单片机时钟系统较为复杂,有内部高/低、外部高/低 、PLL锁相环时钟,又有AHB总线时钟、APB1/2时钟,而例子中很少讲到系统时钟的默认配置是怎么配置呢?那么就发点时间研究下这个单片机内部的复杂时钟系统吧。 下图是STM32F2系列的时钟树结构图: 1、内部高速时钟HSI、外部高速时钟HSE和PLL时钟PLLCLK时钟都接到了SW开关处,通过SW选择哪一路作为SYSCLK,SYSCLK经过AHB分频器进行分频得到HCLK,APB1和APB2是挂在总线AHB上的,通过APB1和APB2分频得出fpclk1和fpclk2。 2、PLL输入时钟源主要是靠外部高速时钟和内部高速时钟作为时钟源,通过PLLCFGR寄存器的bit22来选择具体哪一路作为时钟源。选择好了时钟源进入/M分频器,也就是PLLM进行分频,送入VCO,在通过xN,进行倍频,也就是PLLN1)通过/P进行分频(PLLP)得到PLLCLK;(2)通过/Q分频(PLLQ),得到PLL48CK。 然后边看代码边对照结构图进行分析,看软件如何给单片机配置系统时钟的。
+ q1 l' ^3 Z! J
" v5 x# X/ E% f
然后找到启动代码“startup_stmf32xx.s”,该代码是用汇编写的,可以看到,在调用main函数之前,是先调用了SystemInit函数的,该函数是在“system_stm32f2xx.c”中 - ; Reset handlerReset_Handler PROC+ ]5 h+ i* x5 g u
- EXPORT Reset_Handler [WEAK]
3 A m# a' Y$ N; X8 e - IMPORT SystemInit+ Y' _$ l# D7 k. q; b# ]7 m
- IMPORT __main
x8 Z! T- ]; S: k8 r& d6 O4 P - LDR R0, =SystemInit# P- p: `3 f. k' {, h
- BLX R0
$ |. H7 f+ h' Y7 k- k% | - LDR R0, =__main; e0 k% f) x5 A7 K! f
- BX R0
6 f D0 h- v3 v3 b - ENDP
复制代码 : ~- b- c- F3 }/ s7 A N
代码如下,变量直接赋个16进制的数,都不知道是啥意思,目的是干什么的,不知道,所以看下面代码时最好对照STM32F2x用户手册。当然这个只是一个初始化,待会主要看SetSysClock();这个函数,在调用该函数之前,我们知道单片机是先启用了内部高速时钟等一些配置。 ' R9 Q1 P# V% t1 A5 H$ T
- void SystemInit(void)/ ~6 j: @4 f, V0 y
- {
: g# [: a7 ]9 p - /* Reset the RCC clock configuration to the default reset state ------------*/5 w& A7 q/ A: A& k5 T& u
- /* Set HSION bit */
5 `1 }( Q' s$ ?7 c6 s3 ` M% E5 F! B2 R - RCC->CR |= (uint32_t)0x00000001; //RCC_CR复位值0x0000_xx83,内部高速时钟使能,也就是说上电开始就使用内部高速时钟,16MHZ
: D Z' _# a0 a; E+ H9 a - 9 U' j, d( h. K- Q' A. O/ q
- /* Reset CFGR register */
, A. z5 y7 y5 U- M4 W# T - RCC->CFGR = 0x00000000; //通过开关SW选择内部高速时钟作为系统时钟16MHZ1 Q9 T1 Z( d9 [
- //AHB prescaler 不分频
3 n0 m) S. }0 ^" Q5 e, z - //APB Low speed prescaler (APB1) 不分频,fplck1 = 16MHZ( A B2 j/ i! o: x* B" m* M$ y4 _- ?
- //APB high-speed prescaler (APB2)不分频,fplck2 = 16MHZ0 g8 L4 R8 t- d5 S) L4 G& J R
- //MCO1和MCO2时钟输出等配置可参考用户手册Page95
, s" b) l$ b6 X9 v9 Z' }5 [
+ `9 _6 d4 _9 k% ]- /* Reset HSEON, CSSON and PLLON bits */ {$ ?$ l0 Z2 K! ]+ d
- RCC->CR &= (uint32_t)0xFEF6FFFF;: h( ~2 g7 A \
: J3 A# O. w' f9 l% }- /* Reset PLLCFGR register */
+ W, T" b2 {5 `7 l& ? - RCC->PLLCFGR = 0x24003010; //RCC_CFGR复位值是0x2400_3010, c+ @+ C& h. Y2 }# v+ r
- 0 s1 d3 j" ?/ y
- /* Reset HSEBYP bit */
7 ~# Y3 Q) q' M - RCC->CR &= (uint32_t)0xFFFBFFFF; //对bit18 HSEBYP 设置为0,外部高速时钟被禁止
& ?& ]' R" r% x2 }. Z6 S) l, a1 A7 o) V
0 | I) u+ H' `( |- /* Disable all interrupts */, } \4 y1 X4 A! p# V8 K+ H+ {5 T* B
- RCC->CIR = 0x00000000; //所有时钟中断都被禁止7 M' x& x1 l! E$ u
) N7 U0 O; a6 m1 ]" q& a- #ifdef DATA_IN_ExtSRAM
x8 \- P. k: o0 d4 s- ? - SystemInit_ExtMemCtl(); 8 S5 L! N: G& x8 r7 E1 t& Y
- #endif /* DATA_IN_ExtSRAM */7 _) m/ i& k, a1 ^) C
-
7 j6 U+ y/ I/ B$ ` - /* Configure the System clock source, PLL Multiplier and Divider factors, ' K; [$ V3 s1 |2 m8 F4 C; p
- AHB/APBx prescalers and Flash settings ----------------------------------*/
; i2 j! w+ V+ p - SetSysClock();" b/ r @" e, z, Y) _3 L4 S8 q
6 ^9 o( B, j4 B* q5 n- /* Configure the Vector Table location add offset address ------------------*/
8 I8 ^& J6 P. D! \5 t - #ifdef VECT_TAB_SRAM
4 t, K: N7 o8 p/ [ - SCB->VTOR = SRAM_BASE | VECT_TAB_OFFSET; /* Vector Table Relocation in Internal SRAM */- _$ L5 D: E, N: d# A
- #else
$ l: [4 A0 j. b; G - SCB->VTOR = FLASH_BASE | VECT_TAB_OFFSET; /* Vector Table Relocation in Internal FLASH */$ V: w$ v% K0 a; m3 j }
- #endif
, M9 r" c; a5 ~) R: E1 O: l% _1 y - }
复制代码6 q8 g) J1 C# [* H2 n0 B X" o# v
在SystemInit(void)函数中在配置完一些参数后,还调用了SetSysClock()函数,该函数代码如下 - static void SetSysClock(void)* ~, c# T8 d; p9 x; W- k+ _
- {
- l) D& ]6 Z2 ^" W - /******************************************************************************/9 g0 l7 T+ W- ^
- /* PLL (clocked by HSE) used as System clock source *// Q. L: C+ Z/ U! h
- /******************************************************************************/6 }8 {; H! x, t' R" W& o0 s
- __IO uint32_t StartUpCounter = 0, HSEStatus = 0;
* ~2 t$ H6 K6 A* ^# N1 Q - $ @1 T" }) V7 r& F* o. m8 l! A& |# `
- /* Enable HSE */* N/ H R( v! H3 r4 B' ~4 r
- RCC->CR |= ((uint32_t)RCC_CR_HSEON); //外部高速时钟使能,25MHZ* V, j0 R/ f' a( ^7 t. p, ?
-
$ o: B7 l- [0 c4 A6 }7 L - /* Wait till HSE is ready and if Time out is reached exit */ //外部时钟使能后,得需要一点时间到达各个端口
6 a; |. `% {. O5 l+ I - do0 \6 E7 k/ k! A' Z5 Q# p# }
- {
( N9 r% s8 s4 q/ B1 Y - HSEStatus = RCC->CR & RCC_CR_HSERDY; //如果RCC_CR_HSERDY为0,说明外部时钟还没准备好,1说明外部时钟已准备好
& a. P' b& g5 }! y6 P, c$ c; T - StartUpCounter++;//对读的次数进行累加,当累加次数到达1280次时,就意味着启动时间超时
7 S& ?* s3 v( C* O# C4 X - } while((HSEStatus == 0) && (StartUpCounter != HSE_STARTUP_TIMEOUT));
. R4 v4 G% n. S7 {% X4 r
4 R. A" W+ r- q; f0 P2 ?+ `- h! Q H- if ((RCC->CR & RCC_CR_HSERDY) != RESET)//这里判断上面的do while循环是因哪个条件结束的
4 ~) Z' C, K3 s. w$ f; u - {
" [2 I6 L& U" ~6 a! P: u, f - HSEStatus = (uint32_t)0x01; //说明时钟已准备好了,才结束do whlie循环, z; ^9 Z# `/ J9 y/ T3 a* R
- }3 N }8 ]5 \% W/ E6 [) ]& }
- else
: {, L$ g% }7 o' e4 |9 E& r" P - {
/ w6 P$ B$ d) _. `, M - HSEStatus = (uint32_t)0x00; //说明是因为超时了而退出do while循环# k% e, r5 I$ _
- }; h! }8 C' t ~$ _
8 j9 U) U- F- t# b; D5 ?- o4 F- if (HSEStatus == (uint32_t)0x01)" C$ Q3 O5 z9 W/ r% \
- {) W* P) Y& I/ E5 J) Q
- /* HCLK = SYSCLK / 1*/- W; x9 A+ E8 k4 M' v, ]
- RCC->CFGR |= RCC_CFGR_HPRE_DIV1; //AHB不分频,AHB出来后时钟就是sysclk=120M
* q! M: E% Y: w5 j; X -
" Q* o0 U2 i% c0 D/ L ]2 e - /* PCLK2 = HCLK / 2*/' u9 Q+ R. ]* \( e! Y
- RCC->CFGR |= RCC_CFGR_PPRE2_DIV2;//APB2 2分频,fpclk2 = sysclk/2 = 60M
I5 n: o% G1 k" A; L - % z5 { p8 D, m5 U( x+ ]0 N
- /* PCLK1 = HCLK / 4*/
& _6 s$ J# w4 b4 v, S0 F - RCC->CFGR |= RCC_CFGR_PPRE1_DIV4; //APB1 4分频,fplck1 = sysclk/4 = 30M: w3 F2 N5 W- P& E( j6 G
- 6 p* Y7 F' p: C6 z( J! F- Y
- /* Configure the main PLL */ //主要对PLL和PPI2S 进行配置+ _: Y0 V4 Y" h
- RCC->PLLCFGR = PLL_M | (PLL_N << 6) | (((PLL_P >> 1) -1) << 16) |2 W: f7 h ]( r" K; Z' N
- (RCC_PLLCFGR_PLLSRC_HSE) | (PLL_Q << 24);
1 ?) b3 c& P; {# Q) w( s1 g - //配置完后RCC->PLLCFGR = 0x05403c19,然后对照寄存器RCC_PLLCFGR查看哪些位对应哪些功能
- X, q' }% i- o! K) {6 | - //通过bit5~bit0可计算出PLLM=25,那么input VCO = PLL input clock /PLLM = 25M/25 = 1M,对应时钟结构图中的/M
" o' `! O" G" N - //通过bit14~bit6可计算出倍频因子PLLN = 240,那么VCO output clock = PLLN * input VCO = 240 * 1 = 240M,对应时钟结构图中的xN
. K# v: Y; J+ U; E# c - //bit17~bit16可计算出分频因子PLLP = 2,那么PLLCLK = VCO output clock /PLLP = 240/2 = 120M
: y; [ b1 ~3 d8 Q - //bit22是选择给PLL输入的时钟源,输入时钟源有外部和内部高速时钟,这里选择的是外部高速时钟即PLL input clock = HSE =25M
- G- d5 |/ v0 j$ [# L2 u+ k- g% h - //bit27~24可计算出分频因子PLLQ = 5,那么PLL48CK = VCO output clock/PLLQ = 240/5 = 48M
1 h% z( X2 K0 j6 m. g2 A - 4 y; v6 W& Q. L% C" n/ Q
- /* Enable the main PLL */1 J M: A% m( `' A6 {! c
- RCC->CR |= RCC_CR_PLLON; //使能PLL2 s& g+ V7 A% l/ B0 b6 }
( ~/ h" U6 c# h- /* Wait till the main PLL is ready */( I, |& o4 y4 N0 m- d
- while((RCC->CR & RCC_CR_PLLRDY) == 0)
' k; W% R: V, \. t9 b - {
3 |3 M1 r! W# _3 _+ ~& P - }
% x! s1 n" W7 z& `: u - //到这里RCC->CR已配置完,最终值0x03036783$ b1 i3 D- d+ X- H+ _5 v
- //通过查看用户手册知道,内部高速时钟、外部高速时钟、PLL时钟都已开启
: b: P) l$ j' W/ a( `7 l - ! D$ ], \) l' |
- /* Configure Flash prefetch, Instruction cache, Data cache and wait state */
; x/ k( U0 ^% q+ R7 g9 H - FLASH->ACR = FLASH_ACR_PRFTEN | FLASH_ACR_ICEN | FLASH_ACR_DCEN | FLASH_ACR_LATENCY_3WS;& E$ E3 B; V4 Z: }. g3 d' x
% n) H) Q3 u4 Z- /* Select the main PLL as system clock source */
5 g, w# h' I3 w7 k5 X% i6 [ - RCC->CFGR &= (uint32_t)((uint32_t)~(RCC_CFGR_SW));; \% W& j* R# U, V
- RCC->CFGR |= RCC_CFGR_SW_PLL;
- A% o/ i" ]9 Z1 X7 ]8 Y9 g4 o -
: a ?1 f- Y7 ^3 j8 [ - //到这里RCC->CFGR已配置完,最终值是0x0000_940A" K3 h. [' O5 F4 ^+ ~1 m" s% L
- //通过查看用户手册,知道,PLL时钟作为系统时钟即120M. H) X8 x; C2 ]: R* X0 p' o9 `
- //AHB不分频,即HCLK = 120M9 @: A# v1 Z* D# h2 D
- //APB1 4分频,即fpclk1 = 120/4=30M
l2 j( _3 f* U/ V( R0 }# | - //APB2 2分频,即fpclk2 = 120/2=60M
- ]- ~% F6 X5 f Q- u: q ^
; P. w# x+ f9 }7 P- /* Wait till the main PLL is used as system clock source */
1 e U1 `% b. T& p% }4 j X4 ] - while ((RCC->CFGR & (uint32_t)RCC_CFGR_SWS ) != RCC_CFGR_SWS_PLL);
2 H) F- J7 e7 @* H" o5 v - {2 L- ~! D l) Y* i. V
- }
' ^8 z2 o4 I, H, V' w. |% z5 B - }
6 d f- q I2 T& r c - else8 s6 @0 J6 |& D9 |
- { /* If HSE fails to start-up, the application will have wrong clock* g& z' `6 Z# S4 h0 V$ Q
- configuration. User can add here some code to deal with this error *// a. i6 e, q6 L0 y* F
- }, F1 `1 a5 _# c, m( H$ N2 H
- ; E/ C. Z0 g4 i+ {' x8 C& }6 m
- }
复制代码( {9 N s3 _: f) I
OK,分析完这段代码后,调用系统固件函数后,现在知道了时钟树结构图中右边出来的时钟是多少MHz了吧。 总结: 1、使用的是外部时钟25MHZ,通过PLL进行分频倍频分频得到PLLCLK 120M,PLLCLK作为系统时钟SYSCLK。 2、APB1出来是30M,也就是FPCLK1。 3、APB2出来是60M,也就是FPCLK2。
) L; O! m" m: h2 F( Y- n3 I4 N/ b8 C* L3 c0 u/ |% R- b
# G8 X* g/ X, [7 \2 V% M% O4 s
$ K; k; j4 }' t; P ^* |
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