
1. 前言 为了让客户在原理图设计阶段少走弯路,我这里结合客户评估和设计阶段常遇到的问题,整理了一下 BlueNRG-1/-2 相关设计及注意事项以备客户解惑用。8 a, N2 ]8 A) ]! |3 J* q4 o 2. BlueNRG-1/-2 的原理图参数说明及设计注意事项 2.1. BlueNRG-1/-2 原理图及参数如下: 3 a' L9 p$ S" F, o @& }' F ![]() 0 y% x+ V r9 b6 N6 D ![]() ) ?& S* |2 d- I( {' ] ![]() 5 I& J( t( }( v8 D$ P4 R4 X$ ]& U 2.2. 原理图设计注意事项: 1. C4 的取值只能是 150nf 或者 220nf,否则会影响系统的稳定。 2. 设计成 SMPS ON 的是时候,D1 中的 pin1 和 pin2 之间焊接一颗电感,该电感的具体要求如下:标称值为 10 uH 或 4.7 uH ,但 DCR 务必小于 1ohm 且额定电流必须大于 100 mA。 3. RXD/TXD 必须接到 DIO11 和 DIO08 pin,否则后续将无法使用 RF Flash utility 工具和 BlueNRG GUI 工具。 4. 这里的 L1=2nH,L5=3.9nH 建议保留,这有助于抑制最后通道的杂散并减少晶体和RF 信号间的相互影响。 , K# H9 \4 h( c 5. 建议预留 ANATEST0 pin 和 ANATEST1 pin 的测试点,以便后续测试高速晶体的启振时间。 6. DIO7 建议通过 100kohm 电阻接地并预留测试点:为强制执行 updater 代码(参见预先编程的引导加载程序),建议将 IO7 引脚拉高并硬件复位设备。 ) b* D. V0 z' J6 I' P# Z : _' M. T$ g/ ? 3. BlueNRG-LP/LPS 的原理图参数说明及设计注意事项 3.1. BlueNRG-LP 原理图及参数如下: $ g$ c v0 M! X: x8 Q ![]() 2 Y8 r3 b0 }$ B0 c* p ![]() 3.2. BlueNRG-LPS 原理图及参数说明如下: $ @3 }. b: L! a' F( }% t# I 1 h' x5 C; M- [9 ^7 i ![]() ![]() / q: }! H- U+ b, x4 W/ h1 {! G 3.3. 原理图设计注意事项: : Y- y- h1 p; h9 ] 1. CAP 的取值只能是 150nf 或者 220nf,否则会影响系统的稳定。 2. 设计成 SMPS ON 的是时候,D1 中的 pin1 和 pin2 之间焊接一颗电感,该电感的具体要求如下:标称值为 10 uH 或 2.2 uH 或 1.5uH,但 DCR 务必小于 1ohm 且额定电流必须大于 100 mA。! `6 {7 a3 c9 R+ {: W9 A , X2 @- Q. S4 n5 K5 m- ^ ![]() 3. 对于 BlueNRG-LP 芯片 RXD/TXD 必须接到 PA8 和 PA9 pin,而对于 BlueNRGLPS 芯片 RXD/TXD 必须接到 PB0 和 PA1 pin。否则,后续将无法使用 RF Flash utility 工具和 BlueNRG GUI 工具。 : l/ P- q% {- W 4. 实际应用中 Q1(32KHZ 晶体)可以省略,Q2(32MHZ 晶体)需符合 Fnom=32Mhz,fTOL建议选择±20ppm, PD 不要超过 100uW,CL 选用 6~8pf 的。 4 z) C5 @: r( i3 l 5. 建议预留 VCAP 和 PB6 pin 的测试点,以便后续测试高速晶体的启振时间。 + S% d8 ^$ H/ _9 G5 J1 J 6. PA10 建议预留测试点。 7 @1 b. n) ~# q2 Z9 \( ^ }$ A) P ; K8 L1 ]" {+ s. | & ?% P; p# O6 i+ P4 m) L6 r0 ]3 e 4. 小结 为方便客户、代理 FAE 更好地理解 DEMO 板的原理图,以便客户项目顺利进行, 以及方便后续的测试和调试,这里特意分享以上章节针对不同 DEMO 板的原理图和设计事项做了说明。 完整版请查看:附件 ![]() |
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