FLM算法文件工程代码需要特别注意什么吗?
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发生问题是因为发生了未对齐访问 也就是我读取到SCB->CFSR寄存器为0x01000000,我正在寻找是哪里出现了未对齐访问
在M7 TRM的手册里有这样的说明 device 和strongly-ordered 是不能未对齐的,normal是可以的,所以我配置成normal类型是可以用的,device和strongly-ordered类型会硬错误
Cacheable=Disable;
Bufferable=enable;
shareability =disable;
如果你想把某块区间配置为strongly ordered属性,意味着这块区域是共享的。
就你现有配置,此时那个shareable属性怎么设置不关注了。
然后你调整Cacheable permission又OK了,假定其它配置如你贴图所示,这时
这块存储空间变成不共享了。 难道说是因为共享访问导致的异常?
不过可以肯定,这块区域的Cacheable属性是可以开、关的。
感觉你是担心因为Cache导致一致性问题,这个地方配置成device属性比较合适。
比如你这样配置试试:
TEX=0;
Cacheable=Disable;
Bufferable=enable;
至于shareability配置,你根据需要来,需要共享就enable,不需要就disable.
是因为SRAM1-3的地址空间不可以设置为Strongly ordered类型吗
不太行 不过TEX=1 C=0 B=0 S=0或者TEX=0 C=1 B=0 S=0 都是OK的 是不是SRAM本身必须要用Normal,而不能用device或者Strongly ordered类型啊
[md]en.谢谢反馈!
strongly ordered是有这个限制。不过 非对齐访问导致出错 是可以看到相关提示的。
还有就是你这个地方不建议配置为strongly order,太浪费性能了。