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请问一下STM32F103C8T6的Hardwar NSS Output ENABLE后cs持续拉低是为什么
foc2.0函数SVPWM_3ShuntCalcDutyCycles看不明白
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应该不是这样的,假设是,那也是最后一个脉冲50%不正常而已,而现在不管输出数据多长,最后一个脉冲都会在第一个输出,且奇怪的是输出总数还是对啊。感谢回答。
好的,这两点我再仔细研究下,感谢提醒。