前言本文档描述在 STM32MP1 系列 MPU 上配置 DDR 子系统（DDRSS）所需的流程和步骤。
1 f8 {4 Z. |/ i8 n$ L: A6 J' Y, b% B通过设定 DDR 控制器（DDRCTRL）、PHY 接口（DDRPHYC）和 SDRAM 模式寄存器的多个参数和设置完成 DDRSS 配置。根据 DDR 类型、DDR 大小、DRAM 拓扑、运行时间频率和 SDRAM 器件数据手册参数确定这些参数。所有这些参数必须在初始化序列期间设定。
STM32CubeMX DDR 测试套件使用直观的面板和菜单隐藏了与确定正确参数和初始化启动相关的复杂性（请参考[6]）。为了快速设置要运行的 DDRSS，用户只需提供很少几个输入即可完成配置。可以使用一些高级用户模式和特殊功能（当它们对于应用而言十分重要时）。
( T! n2 V! K* G' U7 w7 U在系统启动阶段，为了优化时序裕量，支持多种 PHY 调谐。可以使用 STM32CubeMX 启动这些调谐。PHY 调谐结果可以保存并在后续冷复位时恢复。
在启动阶段，用户可以运行大量测试套件。这些测试可以使用 STM32CubeMX 启动，并用于确认 DDR 配置的稳健性。
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7 @6 Q. y( K* p5 d1 z1  概述
6 V' m: f  A/ \5 @( w& k9 B, A本文档适用于 STM32MP1 系列基于 Arm®的 MPU。
$ ?" J8 `. `# ]$ e$ x& E" D; V4 N6 l提示 Arm 是 Arm Limited（或其子公司）在美国和/或其他地区的注册商标。

0 m, t) h" y/ Z( t' ^8 w/ B2 DDR 子系统初始化和配置
DDR 子系统包括 DDRCTRL 和 DDRPHYC（参见下图）。
DDRCTRL 支持在正常操作期间通过命令和刷新调度进行 DDR 命令调度。
DDRPHYC 是一种 DDR PHY 接口，具有连接 DDRCTL 的 DFI 接口[7]和字节通道架构，适合连接频率不超过 533MHz 的 DDR3/3L 和 LPDDR2/3。
- Y7 @) y% z0 v% Y! E. WDDRPHYC 完全支持具有多个 PHY 调谐选项（内置）的 DDR 初始化。DDRPYC 包含 BIST 引擎，用于支持软件驱动的调谐。
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2.1 DDRSS 和 SDRAM 初始化
  W: O' d: Z6 K( x$ e& @6 I器件根据 SDRAM 启动序列对电源、时钟和复位进行内部排序。
图 2 所示的 PHY 初始化序列由 DDRPHYC 物理实用模块（PUB）控制。这一基于 PUB 的初始化序列在DDRPHYC 从复位状态释放后启动，并根据 DDRPHYC.PIR 寄存器进行排序。
初始化序列包括以下步骤：
1. DDRCTRL 和 DDRPHYC 初始化包括内部时序模块（ITM）复位以及 DLL 复位和锁定
5 }7 }3 S1 e* Y3 U" |. ?1 X2. DDRPHYC I/O 初始校准（ZCAL），与 DLL 锁定同时启动
' u& `; j. k' ~" d3. 通过模式寄存器写入和校准命令执行 SDRAM 初始化
4. 内置 DQS 门控训练（DQSTRN）
- O+ _* R3 g& R5 i6 s提示 • 在 SSTL 模式下为所有 SDRAM 设置 DDRPHYC I/O。
* F% C" m* h2 E. f+ F2 @• DQS 门控训练是可选的。但是，建议在每次初始化时运行内置 DQS 门控训练。
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2.3DDRCTRL 配置
大多数 DDRCTRL 寄存器是静态的，并在 DDRCTRL 从复位状态释放和 AXI 端口使能前加载。这是在 DDR 软件驱动器的支持下实现的。
4 H: c- Z  A. M# O. M' P在 DDRPHYC 和 DDCTRL 完成初始化后，DDR 子系统就绪，使能 AXI 端口是最后一个步骤。
通过从 STM32CubeMX DDR 面板选择的菜单/选项提供的极少信息确定 DDRCTRL 和 DDRPHYC 寄存器的配置。然后，DDRSS 配置被保存并恢复到 DDRCTRL 和 DDRPHYC 寄存器，用于后续的复位和正常操作。

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1 z/ q6 k8 B! `% o4 ?" Q4 [6 }# [2.3 DDR 配置
配置 DDR 所需的步骤如下：
1. 为 DDRCTRL 和 DDRPHYC 寄存器确定并设定合适值。
0 u9 y& }# v+ `2. 启动 DDRCTRL 和 DDRPHYC 初始化序列。
* b* @6 A& K+ r" C3. 启动具有参数保存和恢复功能的 DDR 调谐（可选）。
0 T8 O) x. b5 y% v0 K7 ?4. 启动 DDR 测试（可选）。完整配置流程和参数如下图所示。



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2.4DDR PHY 调谐
% I1 K, l: W' v除了使用强制 DQS 门控训练（DQSTRN）确定读脉冲期间 DQS 门控的最佳位置，DDRPHYC 还支持两种读取时序优化，即 PHY 调谐。
以下从 STM32CubeMX 驱动的软件例程支持 PHY 调谐，以优化读时序裕量：
• DQS 门控训练（可在 DDR PHY 调谐期间以交互方式启动的软件）
• DQ 位去时滞，以补偿 DQ 位通道读取延迟
• DQS 眼图居中，用于调节 DQS/DQS#延迟以实现最佳 DQ 采样
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3 {/ `( c% H, n, E5 D2.5 DDR 测试
在初启阶段使用 DDR 之前, 必须运行 STM32CubeMx 建议的所有测试和级别。第 8 节 STM32CubeMX 的 DDR 测试中描述了 DDR 测试和测试流程，以及故障诊断和处理措施。DDR 子系统初启在 DDR 配置、调谐和压力测试成功后完成。保存配置参数用于正常运行模式初始化和 DDR run 模式。


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