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作为电子工程师，必然在PCB设计中遇到各种各样的问题，本文提出常见的几种问题供工程师们参考。你遇到过这种问题吗？ 0 A2 i# }1 p! E% | 焊盘(除表面贴焊盘外)的重叠，意味孔的重叠，在钻孔工序会因为在一处多次钻孔导致断钻头，导致孔的损伤。, g8 L5 m% Y. } S9 O2 C* h( ]0 E8 } 多层板中两个孔重叠，如一个孔位为隔离盘，另一孔位为连接盘(花焊盘)，这样绘出底片后表现为隔离盘，造成的报废。 3 H4 p5 G* z# \+ A* w- N' \0 ` - V2 F3 N& J w; b! q0 A4 x Ⅱ. 图形层的滥用 8 r# ~" d; I/ ^3 p H, { 在一些图形层上做了一些无用的连线，本来是四层板却设计了五层以上的线路，使之造成误解。7 t' v8 o" @& C- R3 | 设计时图省事，以Protel软件为例对各层都有的线用Board层去画，又用Board层去划标注线，这样在进行光绘数据时，因为未选Board层，漏掉连线而断路，或者会因为选择Board层的标注线而短路，因此设计时保持图形层的完整和清晰。; t$ w/ a0 N% } 违反常规性设计，如元件面设计在Bottom层，焊接面设计在Top，造成不便。8 r' o, o% F5 \$ N0 D* Y 4 t. f1 g( g- w Ⅲ. 字符的乱放 + o) {, s2 q4 U! @+ m" V% f8 R z& [ 5 P; @; q4 o) r 字符盖焊盘SMD焊片，给印制板的通断测试及元件的焊接带来不便。 字符设计的太小，造成丝网印刷的困难，太大会使字符相互重叠，难以分辨。 Ⅳ. 单面焊盘孔径的设置 9 p2 z: N4 T9 u3 S; M 单面焊盘一般不钻孔，若钻孔需标注，其孔径应设计为零。如果设计了数值，这样在产生钻孔数据时，此位置就出现了孔的座标，而出现问题。 单面焊盘如钻孔应特殊标注。 3 L2 @4 _9 O' W* s3 {- H Ⅴ. 用填充块画焊盘 & v2 O+ ?+ @3 ^+ R8 M0 X 用填充块画焊盘在设计线路时能够通过DRC检查，但对于加工是不行的，因此类焊盘不能直接生成阻焊数据，在上阻焊剂时，该填充块区域将被阻焊剂覆盖，导致器件焊装困难。 Ⅵ. 电地层又是花焊盘又是连线: d& x+ h4 L. K4 d- [/ T# a; r( K F. G 2 Q2 x) d6 b- q: \% ]- K% z& l 因为设计成花焊盘方式的电源，地层与实际印制板上的图像是相反的，所有的连线都是隔离线，这一点设计者应非常清楚。这里顺便说一下，画几组电源或几种地的隔离线时应小心，不能留下缺口，使两组电源短路，也不能造成该连接的区域封锁(使一组电源被分开)。 6 ]: H% Q8 k$ @: Z" S" r6 l Ⅶ. 加工层次定义不明确 单面板设计在TOP层，如不加说明正反做，也许制出来的板子装上器件而不好焊接。 例如一个四层板设计时采用TOP mid1、mid2 bottom四层，但加工时不是按这样的顺序放置，这就要求说明。! L$ o: G( U* ~6 v " K; _' F; H/ a/ j! T+ W+ Q/ { Ⅷ. 设计中的填充块太多/用极细的线填充 ( d% t% b& n2 f; x i / h( ^8 b1 n0 Y# ]2 x8 J 产生光绘数据有丢失的现象，光绘数据不完全。 % w, z0 f: y6 O) N' T* z8 k 因填充块在光绘数据处理时是用线一条一条去画的，因此产生的光绘数据量相当大，增加了数据处理的难度。 % \& O3 @( m/ q# B, [$ g 这是对通断测试而言的，对于太密的表面贴装器件，其两脚之间的间距相当小，焊盘也相当细，安装测试针，必须上下(左右)交错位置，如焊盘设计的太短，虽然不影响器件安装，但会使测试针错不开位。 1 V6 u$ }1 i" r Ⅹ. 大面积网格的间距太小 " ?! v% A8 P# T: O( G/ V 组成大面积网格线同线之间的边缘太小(小于0.3mm)，在印制板制造过程中，图转工序在显完影之后容易产生很多碎膜附着在板子上，造成断线。 ; n; l5 G- D" A; n$ k$ n, M0 X! b XI. 大面积铜箔距外框的距离太近 * g: u" k, P# A. v. c9 j; h7 k大面积铜箔距外框应至少保证0.2mm以上的间距，因在铣外形时如铣到铜箔上容易造成铜箔起翘及由其引起的阻焊剂脱落问题。/ x( U0 z" j* ^ 3 j/ i1 e1 T2 {. @ XII. 外形边框设计的不明确" J8 Y1 D" x# `3 D4 Z: q * X3 ]3 A x1 M$ I5 g; n: |* @7 B' Z / V9 K! k% Z! d t& k 有的客户在Keep layer、Board layer、Top over layer等都设计了外形线且这些外形线不重合，造成pcb生产厂家很难判断以哪条外形线为准。 XIII. 图形设计不均匀 在进行图形电镀时造成镀层不均匀，影响质量。% C- k$ I5 z2 D- M + h4 o+ m' F' G( L4 n" p" a# E XIV. 铺铜面积过大 & X/ o. n0 ?) D7 | 2 W6 g9 ~0 N, l6 l, p7 F* H3 b 铺铜面积过大时应用网格线，避免SMT时起泡。4 o) f3 b4 S& B) E1 N, y& Z" X |
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