使用定时器触发ADC采样PWM正脉冲时刻的负载电压电流,触发ADC的定时器用的就是产生PWM的定时器,设置为上升沿触发,测试发现每个PWM周期内ADC被触发了两次,一次是PWM上升沿的时候,另一次是PWM低电平的时候,不知道为什么每个PWM周期内会触发第二次采样? 此外,如何确保ADC采样到PWM正脉冲的中间时刻呢? 测试波形 CH1: 定时器产生的其中一路PWM波形(两路PWM交替开启) CH2: ADC采样完成DMA中断函数-连续反转GPIO输出的波形 配置如下: 定时器4:产生两路PWM信号驱动负载,同时将输出触发设置为 Update Event触发ADC采样 ADC: 三个通道连续采样,由定时器4的上升沿触发,DMA循环模式搬运采样结果到内存-开启DMA中断 DMA中断:连续反转GPIO,便于用示波器观测采样时机 |
软件为keil5,头文件未找到
通过FATFS文件系统读写SD卡创建文件可以了,但加入MSC,一直显示一个没有格式化的U盘盘符,也不能格式化,这是什么问题导致的
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各位大佬,比方说我用STM32CubeMX配置了单片机的管脚,然后用STM32CubeIDE编写代码,代码编写一半的过程中,我发现管脚配置中要添加新的外设设置,用CudeMX添加配置后重新生成代码,怎么保证我之前在CubeIDE中自己编写的代码部分不被覆盖掉?
通常比较合适的做法是将代码放在完成中断的回调函数里。
所以放在 IRQhandler 里面很可能执行了两次。
不妨调试看看是不是这个原因。
你到底是基于PWM的比较事件触发ADC 还是基于ADC的周期性更新事件触发ADC;
你提到的上沿是模糊的说法,PWM输出可以自由配置,即使相同CCR和ARR值不同的输出模式,上下沿的位置会不同;
你现在到底是连续采样还是基于定时器触发才采样,基于你现在的配置,就是每次定时器更新事件触发3次采样。
你用到DMA完成中断,这个中断跟你一轮完成的数据个数有关,假设你现在传输3个数据为一轮,即发生三次采样后发生完成中断;
您好,
我的目的是每次定时器触发3个通道的ADC采样(每次触发每个通道都要采样一次),预期的采样时间是PWM输出为正的那段时间里(最好是正中间)。
谢谢!确实是这个原因导致的。
你好,我这里请教几个稍有偏离的问题,希望不会太麻烦你:
传输一半中断,是有什么用处?
是否可以关闭这个传输一半中断?
谢谢~