01. DAC简介
* h- ~9 x8 C% |7 YDAC 模块是 12 位电压输出数模转换器。DAC 可以按 8 位或 12 位模式进行配置，并且可与DMA 控制器配合使用。在 12 位模式下，数据可以采用左对齐或右对齐。DAC 有两个输出通道，每个通道各有一个转换器。在 DAC 双通道模式下，每个通道可以单独进行转换；当两个通道组合在一起同步执行更新操作时，也可以同时进行转换。可通过一个输入参考电压引脚 V REF+ （与 ADC 共享）来提高分辨率。

3 ?# N8 l5 F7 t: }5 q02. DAC主要特性
● 两个 DAC 转换器：各对应一个输出通道
● 12 位模式下数据采用左对齐或右对齐
● 同步更新功能
● 生成噪声波
● 生成三角波
● DAC 双通道单独或同时转换
● 每个通道都具有 DMA 功能
0 c7 }- G# ?' `1 T4 I$ l$ I7 |: Y, w● DMA 下溢错误检测
● 通过外部触发信号进行转换
● 输入参考电压 V REF+

9 V) D2 I9 j! h7 @4 V0 V9 {
1 E' b) Q( f1 n6 f6 I

/ F! g4 Q1 n: t温馨提示
2 F! ^3 m* Q1 {1 z# v, x( |
使能 DAC 通道 x 后，相应 GPIO 引脚（ PA4 或 PA5 ）将自动连接到模拟转换器输出(DAC_OUTx) 。为了避免寄生电流消耗，应首先将 PA4 或 PA5 引脚配置为模拟模式 (AIN) 。

03. DAC功能说明
- S( \& I6 I& R8 u, lDAC 通道使能

8 q6 ]0 U6 e0 o& y) u! C. z将 DAC_CR 寄存器中的相应 ENx 位置 1，即可接通对应 DAC 通道。经过一段启动时间t WAKEUP 后，DAC 通道被真正使能。
0 g3 c! M- G! J" Z; y, C, f+ ^
. o9 W% g: s, }, ~8 u2 x: Q+ y5 {7 XDAC 输出缓冲器使能
" O! q. w9 V3 _+ ]% U6 X
DAC 集成了两个输出缓冲器，可用来降低输出阻抗并在不增加外部运算放大器的情况下直接驱动外部负载。通过 DAC_CR 寄存器中的相应 BOFFx 位，可使能或禁止各 DAC 通道输出缓冲器。

' }0 W5 P8 O: v  |* }DAC 数据格式
$ [* a  o9 J- q
根据所选配置模式，数据必须按如下方式写入指定寄存器：
● 对于 DAC 单通道 x，有三种可能的方式：
— 8 位右对齐：软件必须将数据加载到 DAC_DHR8Rx [7:0] 位（存储到DHRx[11:4] 位）。
: I# t( G+ N; A+ L7 }9 K— 12 位左对齐：软件必须将数据加载到 DAC_DHR12Lx [15:4] 位（存储到DHRx[11:0] 位）。
— 12 位右对齐：软件必须将数据加载到 DAC_DHR12Rx [11:0] 位（存储到DHRx[11:0] 位）。

DAC 转换
  A* }5 u, W. F) P
DAC_DORx 无法直接写入，任何数据都必须通过加载 DAC_DHRx 寄存器（写入DAC_DHR8Rx、DAC_DHR12Lx、DAC_DHR12Rx、DAC_DHR8RD、DAC_DHR12LD 或DAC_DHR12LD）才能传输到 DAC 通道 x。
8 b' _) X+ F9 Q5 O" n1 Z& [  O
. ?7 c1 s0 o  p如果未选择硬件触发（DAC_CR 寄存器中的 TENx 位复位），那么经过一个 APB1 时钟周期后，DAC_DHRx 寄存器中存储的数据将自动转移到 DAC_DORx 寄存器。但是，如果选择硬件触发（置位 DAC_CR 寄存器中的 TENx 位）且触发条件到来，将在三个 APB1 时钟
) c5 X1 i( f" H$ x) e周期后进行转移。

: G' w# u$ q$ E/ ^0 ~0 l% N5 J当 DAC_DORx 加载了 DAC_DHRx 内容时，模拟输出电压将在一段时间 t SETTLING 后可用，具体时间取决于电源电压和模拟输出负载。
1 @! u2 @' @# y: ~- N


2 F% ?5 p  c7 t1 N- \DAC 输出电压
% k* u, K% S* E# t
经过线性转换后，数字输入会转换为 0 到 V REF+ 之间的输出电压。各DAC通道引脚的模拟输出电压通过以下公式确定：
  S' j% C! v2 R( B7 g5 k
, [+ x! l* ~: q5 |# L( r
5 a, O, p" W" F$ m1 U* F8 c7 {
DAC 触发选择
: s7 T. a+ h* ~
如果 TENx 控制位置 1，可通过外部事件（定时计数器、外部中断线）触发转换。TSELx[2:0]控制位将决定通过 8 个可能事件中的哪一个来触发转换，如 表 58 所示。


6 ]. J; `& ~; P3 {
DMA 请求

每个 DAC 通道都具有 DMA 功能。两个 DMA 通道用于处理 DAC 通道的 DMA 请求。当 DMAENx 位置 1 时，如果发生外部触发（而不是软件触发），则将产生 DAC DMA 请求。DAC_DHRx 寄存器的值随后转移到 DAC_DORx 寄存器。

$ r- d+ L+ [. L# Y3 g8 t在双通道模式下，如果两个 DMAENx 位均置 1，则将产生两个 DMA 请求。如果只需要一个DMA 请求，应仅将相应 DMAENx 位置 1。这样，应用程序可以在双通道模式下通过一个DMA 请求和一个特定 DMA 通道来管理两个 DAC 通道。

生成三角波

可以在直流电流或慢变信号上叠加一个小幅三角波。将 WAVEx[1:0] 置为“10”即可选择DAC 生成三角波。振幅通过 DAC_CR 寄存器中的 MAMPx[3:0] 位进行配置。每次发生触发事件后，经过三个 APB1 时钟周期，内部三角波计数器将会递增。在不发生溢出的情况下，该计数器的值将与 DAC_DHRx 寄存器内容相加，所得总和将存储到 DAC_DORx 寄存器中。只要小于 MAMPx[3:0] 位定义的最大振幅，三角波计数器就会一直递增。一旦达到配置的振幅，计数器将递减至零，然后再递增，以此类推。可以通过复位 WAVEx[1:0] 位来将三角波产生功能关闭。
# M8 T4 K- i" m8 {* J0 \" n5 [: \
( d8 B3 k) X( Q% F- M

04. DAC 双通道转换
$ ^+ H" D* L9 D6 S0 ~为了在同时需要两个 DAC 通道的应用中有效利用总线带宽，DAC 模块实现了三个双寄存器：DHR8RD、DHR12RD 和 DHR12LD。这样，只需一个寄存器访问即可同时驱动两个 DAC通道。

" `- {0 E9 n/ v; q通过两个 DAC 通道和这三个双寄存器可以实现 11 种转换模式。但如果需要，所有这些转换模式也都可以通过单独的 DHRx 寄存器来实现。下面几段内容将介绍所有这些模式。

独立触发（不产生波形）

6 A( V2 ~" Q1 T/ X3 f要将 DAC 配置为此转换模式，需要遵循以下顺序：
● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
" \( \( ^1 x9 y8 A● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为不同的值，以配置不同的触发源
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
DAC 1 通道触发信号到达时，DHR1 寄存器的内容转移到 DAC_DOR1（三个 APB1 时钟周期之后）。
0 N% D" y( W# ]8 aDAC 2 通道触发信号到达时，DHR2 寄存器的内容转移到 DAC_DOR2（三个 APB1 时钟周期之后）。
2 N: E" C6 s# N2 r& d1 |
- y! C" P$ g* F8 |5 O独立触发（生成单个 LFSR ）
7 v4 s" e, _) A' ]2 N* l1 l) K
- n, c. t) k5 k! M要将 DAC 配置为此转换模式，需要遵循以下顺序：
● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
3 \+ e* ~6 v0 J" Q: G# K7 Z7 a● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为不同的值，以配置不同的触发源
● 将两个 DAC 通道的 WAVEx[1:0] 设置为“01”，并在 MAMPx[3:0] 位中配置相同的 LFSR掩码值
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DHR12RD、DHR12LD 或 DHR8RD）DAC 通道 1 触发信号到达时，LFSR1 计数器内容（使用相同的掩码）与 DHR1 寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。LFSR1 计数器随即更新。DAC 通道 2 触发信号到达时，LFSR2 计数器内容（使用相同的掩码）与 DHR2 寄存器内容相加，所得总和转移到 DAC_DOR2 中（三个 APB1 时钟周期之后）。LFSR2 计数器随即更新。

独立触发（生成不同 LFSR ）
5 R' i1 G: f5 T# a- ^  R
要将 DAC 配置为此转换模式，需要遵循以下顺序：
● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为不同的值，以配置不同的触发源
! ?# K  E  i. ]+ l9 J● 将两个 DAC 通道的 WAVEx[1:0] 设置为“01”，并在 MAMP1[3:0] 和 MAMP2[3:0] 位中设置不同的 LFSR 掩码值
+ d# Q2 R, F+ H4 @9 @- r! ]● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
DAC 通道 1 触发信号到达时，LFSR1 计数器内容（使用 MAMP1[3:0] 配置的掩码）与 DHR1寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。LFSR1 计数器随即更新。
DAC 通道 2 触发信号到达时，LFSR2 计数器内容（使用 MAMP2[3:0] 配置的掩码）与 DHR2寄存器内容相加，所得总和转移到 DAC_DOR2 中（三个 APB1 时钟周期之后）。LFSR2 计数器随即更新。
6 D* _& p% L( v. k4 t) M
独立触发（生成单个三角波）

8 Q6 g5 u2 e" n. D. s* T$ g要将 DAC 配置为此转换模式，需要遵循以下顺序：
0 U0 U% K0 M1 W% W2 g● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
, H/ c9 j9 j6 ^9 U$ _" K; ]● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为不同的值，以配置不同的触发源
4 L$ J6 X( J: i1 P" Z; q
. ^& }2 b* V9 J4 J7 J  I( W4 k● 将两个 DAC 通道的 WAVEx[1:0] 设置为“1x”，并在 MAMPx[3:0] 位中配置相同的最大振幅值
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
. B3 L  S* z8 P" n, \$ B4 p; r8 m' l3 FDAC 通道 1 触发信号到达时，DAC 1 通道三角波计数器内容（使用相同的三角波振幅）与DHR1 寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。
+ l& D+ W. [& x' K2 SDAC 1 通道三角波计数器随即更新。
DAC 2 通道触发信号到达时，DAC 2 通道三角波计数器内容（使用相同的三角波振幅）与DHR2 寄存器内容相加，所得总和转移到 DAC_DOR2 中（三个 APB1 时钟周期之后）。
9 V' n& J6 t& Q/ k' t9 e5 ]/ |DAC 2 通道三角波计数器随即更新。

独立触发（生成不同三角波）

要将 DAC 配置为此转换模式，需要遵循以下顺序：
. F' b6 W( _3 D; T7 D/ @● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为不同的值，以配置不同的触发源
● 将两个 DAC 通道的 WAVEx[1:0] 设置为“1x”，并在 MAMP1[3:0] 和 MAMP2[3:0] 位中设置不同的最大振幅值
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
3 B# M% R% {7 y! F8 {DAC 1 通道触发信号到达时，DAC 1 通道三角波计数器内容（使用 MAMP1[3:0] 配置的三角波振幅）与 DHR1 寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。DAC 1 通道三角波计数器随即更新。
DAC 2 通道触发信号到达时，DAC 2 通道三角波计数器内容（使用 MAMP2[3:0] 配置的三角波振幅）与 DHR2 寄存器内容相加，所得总和转移到 DAC_DOR2 中（三个 APB1 时钟周期之后）。DAC 2 通道三角波计数器随即更新。

- V/ W/ U& @  c, |" }同步软件启动

要将 DAC 配置为此转换模式，需要遵循以下顺序：
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
在此配置中，DHR1 和 DHR2 寄存器内容会在一个 APB1 时钟周期后分别转移到 DAC_DOR1和 DAC_DOR2 中。

同步触发（不产生波形）

: q2 v9 q; w# m+ z4 a5 J要将 DAC 配置为此转换模式，需要遵循以下顺序：
8 H" q- [1 y. ^& T● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为相同的值，以便为两个 DAC 通道配置相同的触发源
0 I6 L8 \$ q" v6 u● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
当触发信号到达时，DHR1 和 DHR2 寄存器内容将分别转移到 DAC_DOR1 和 DAC_DOR2中（三个 APB1 时钟周期之后）。

3 [4 y# |, K" @1 A1 q! |1 @+ @6 n同步触发（生成单个 LFSR ）

3 n* m* V4 N) A要将 DAC 配置为此转换模式，需要遵循以下顺序：
: {5 k9 p: `4 u9 b& D● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
' Z0 x: n, o; f: D4 d2 b● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为相同的值，以便为两个 DAC 通道配置相同的触发源
2 L& Z  {6 o5 Q● 将两个 DAC 通道的 WAVEx[1:0] 设置为“01”，并在 MAMPx[3:0] 位中配置相同的 LFSR掩码值
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DHR12RD、DHR12LD 或 DHR8RD）触发信号到达时，LFSR1 计数器内容（使用相同的掩码）与 DHR1 寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。LFSR1 计数器随即更新。同时，LFSR2 计数器内容（使用相同的掩码）与 DHR2 寄存器内容相加，所得总和转移到DAC_DOR2 中（三个 APB1 时钟周期之后）。LFSR2 计数器随即更新。

同步触发（生成不同 LFSR ）

( y0 h& a/ w, A2 L, S8 d要将 DAC 配置为此转换模式，需要遵循以下顺序：
5 ^  N/ M+ g& k8 o● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为相同的值，以便为两个 DAC 通道配置相同的触发源
, a& l+ S+ y8 A2 {+ K1 Z; d& O● 将两个 DAC 通道的 WAVEx[1:0] 设置为“01”，并在 MAMP1[3:0] 和 MAMP2[3:0] 位中设置不同的 LFSR 掩码值
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
触发信号到达时，LFSR1 计数器内容（使用 MAMP1[3:0] 配置的掩码）与 DHR1 寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。LFSR1 计数器随即更新。
同时，LFSR2 计数器内容（使用 MAMP2[3:0] 配置的掩码）与 DHR2 寄存器内容相加，所得总和转移到 DAC_DOR2 中（三个 APB1 时钟周期之后）。LFSR2 计数器随即更新。

同步触发（生成单个三角波）
2 @) ?1 t- |# |6 E) f
- e3 F' B8 ~/ g- j; N% S) G要将 DAC 配置为此转换模式，需要遵循以下顺序：
* ^8 U6 n; _: k1 {● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
5 D# O7 b: p- q8 W8 K. W( t● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为相同的值，以便为两个 DAC 通道配置相同的触发源
● 将两个 DAC 通道的 WAVEx[1:0] 设置为“1x”，并在 MAMPx[3:0] 位中配置相同的最大振幅值
● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
. K: m2 r) M2 C7 _触发信号到达时，DAC 1 通道三角波计数器内容（使用相同的三角波振幅）与 DHR1 寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。DAC 1 通道三角波计数器随即更新。
同时，DAC 2 通道三角波计数器内容（使用相同的三角波振幅）与 DHR2 寄存器内容相加，所得总和转移到 DAC_DOR2 中（三个 APB1 时钟周期之后）。DAC 2 通道三角波计数器随即更新。
3 y; l6 e+ g" c' y/ a
! e  o6 E' s& o: c3 R同步触发（生成不同三角波）

要将 DAC 配置为此转换模式，需要遵循以下顺序：
● 将两个 DAC 通道触发使能位 TEN1 和 TEN2 置 1
) ]! ?+ Y0 I/ `$ s● 将 TSEL1[2:0] 和 TSEL2[2:0] 设置为相同的值，以便为两个 DAC 通道配置相同的触发源
6 b( d* S4 W9 }/ @7 `* [● 将两个 DAC 通道的 WAVEx[1:0] 设置为“1x”，并在 MAMP1[3:0] 和 MAMP2[3:0] 位中设置不同的最大振幅值
# ^1 [, K1 N2 ~$ d● 将 DAC 双通道数据加载到所需 DHR 寄存器（DAC_DHR12RD、DAC_DHR12LD 或DAC_DHR8RD）
触发信号到达时，DAC 通道 1 三角波计数器内容（使用 MAMP1[3:0] 配置的三角波振幅）与DHR1 寄存器内容相加，所得总和转移到 DAC_DOR1 中（三个 APB1 时钟周期之后）。DAC通道 1 三角波计数器随即更新。
同时，DAC 通道 2 三角波计数器内容（使用 MAMP2[3:0] 配置的三角波振幅）与 DHR2 寄存器内容相加，所得总和转移到 DAC_DOR2 中（三个 APB1 时钟周期之后）。DAC 通道 2三角波计数器随即更新。
2 G& R& U/ e, P3 C. |$ Y
% E1 c' T" c, A2 G" B: A/ N: P05. DAC寄存器
$ }' G' A# I/ l! u3 H4 [0 I. T, ^5.1 DAC 控制寄存器 (DAC_CR)
7 `' |3 }; L7 F% \% Z. w* JDAC control register
偏移地址：0x00
# [" v) c+ n; V$ V: k3 _/ _0 r复位值：0x0000 0000

' R3 _: W+ [9 S* r0 s* I

- x; f4 t! J% ]; t* H! n. d, `5 A5.2 DAC 软件触发寄存器 (DAC_SWTRIGR)
DAC software trigger register
4 r& W, k" o: K% s" W偏移地址：0x04
复位值：0x0000 0000
  F, s5 s) k8 T: C7 U
, U; _$ y; ?! j7 P  K: _: |
1 x2 p( x# u( f0 r2 @+ Q1 X, Q0 z
5.3 DAC 1 通道 12 位右对齐数据保持寄存器 (DAC_DHR12R1)
DAC channel1 12-bit right-aligned data holding register
偏移地址：0x08
复位值：0x0000 0000
* ~9 o% j. R. k5 q


5.4 DAC 1 通道 12 位左对齐数据保持寄存器 (DAC_DHR12L1)
DAC channel1 12-bit left aligned data holding register
偏移地址：0x0C
7 X% t8 M; r* M0 D复位值：0x0000 0000

* V/ ~8 w( f% |, m5 e

5.5 DAC 1 通道 8 位右对齐数据保持寄存器 (DAC_DHR8R1)
" T( s, I; z" g3 s! K! |4 LDAC channel1 8-bit right aligned data holding register
  z, l$ L* h" E. E: _- y偏移地址：0x10
, j" c3 h) t, X5 E; f" _复位值：0x0000 0000


2 t6 t6 ?/ c9 }' F, ?9 z( c1 R
5.6 DAC 2 通道 12 位右对齐数据保持寄存器 (DAC_DHR12R2)
DAC channel2 12-bit right aligned data holding register
偏移地址：0x14
复位值：0x0000 0000


- i' e; C* o3 P2 Q& _4 e8 y9 g6 W' H; @
5 O) K2 v6 T  v2 C5.7 DAC 2 通道 12 位左对齐数据保持寄存器 (DAC_DHR12L2)
DAC channel2 12-bit left aligned data holding register
偏移地址：0x18
/ }! P# l8 d( w9 b1 g复位值：0x0000 0000


5 g% J! J4 n6 u" i/ z
5.8 DAC 2 通道 8 位右对齐数据保持寄存器 (DAC_DHR8R2)
9 L' R5 x; V7 y! U4 mDAC channel2 8-bit right-aligned data holding register
偏移地址：0x1C
5 y4 m- d6 s3 Q% v- m, q复位值：0x0000 0000


& ]6 |! M: L* u3 w" b4 w6 e6 ~, D. y* Q
/ E2 `2 c1 `! \1 Y1 z5.9 双 DAC 12 位右对齐数据保持寄存器 (DAC_DHR12RD)
Dual DAC 12-bit right-aligned data holding register
偏移地址：0x20
复位值：0x0000 0000
% @$ k8 k5 R$ P) B$ k/ e7 ]8 c2 \: R


5.10 双 DAC 12 位左对齐数据保持寄存器 (DAC_DHR12LD)
" K1 \9 O, E  m0 ?DUAL DAC 12-bit left aligned data holding register
偏移地址：0x24
复位值：0x0000 0000


/ t6 A  G5 d+ e& _* _, W  X
+ l3 }" h0 S0 o$ Z* x0 h5.11 双 DAC 8 位右对齐数据保持寄存器 (DAC_DHR8RD)
5 D. U2 y0 x$ @% G. i( KDUAL DAC 8-bit right aligned data holding register
: T7 j9 S3 q* i6 K% t偏移地址：0x28
  u/ Z" o% K: a8 k复位值：0x0000 0000
. p' F. k, f- P% a7 t' @


5.12 DAC 1 通道数据输出寄存器 (DAC_DOR1)
% w6 F/ ]! ?8 l" B! k, yDAC channel1 data output register
; g; V8 H$ k4 J# p% p; `偏移地址：0x2C
复位值：0x0000 0000
" m* v0 p, Z: B/ S& ^. I8 n
! b" ]3 y# x7 o' t
: y* Y9 X5 i) l2 g# g8 L( N; Q
5.13 DAC 2 通道数据输出寄存器 (DAC_DOR2)
DAC channel2 data output register
- G: j0 O# q/ O偏移地址：0x30
复位值：0x0000 0000


2 R) x4 ^+ p- x
/ I( }) Q$ I/ ]) n, S5.14 DAC 状态寄存器 (DAC_SR)
4 N+ i. ]! T. I5 d/ g4 YDAC status register
6 G! J% ?0 t! `5 L: k偏移地址：0x34
复位值：0x0000 0000

2 w! m: X* \+ N, r

: b% m8 d% A/ G  Y( N
' d# E9 M( R9 C% ~! I3 }